部分常见问题上

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部分常见问题上

问:从WORD文件中拷贝出来的符号,为什么不能够在PROTEL中正常显示
& Q5 [/ a3 ?/ {, W复:请问你是在SCH环境,还是在PCB环境,在PCB环境是有一些特殊字符不能显示,因为那时保
留字.
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3 r8 n8 P9 f/ E& D, k, p# S问:net名与port同名,pcb中可否连接
8 i* S3 k4 k* Q& X答复:可以,PROTEL可以多种方式生成网络,当你在在层次图中以port-port时,每张线路图可
以用相同的NET名,它们不会因网络名是一样而连接.但请不要使用电源端口,因为那是全局
5 ?' ?8 M) q6 J& v) }; x的.
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( i" Q  d. x# D8 g问::请问在PROTEL99SE中导入PADS文件, 为何焊盘属性改了
% q6 q1 z# L" U4 R复:这多是因为两种软件和每种版本之间的差异造成,通常做一下手工体调整就可以了.

7 s4 ]( @, g" `* |3 r/ P: \5 Y问:请问杨大虾:为何通过软件把power logic的原理图转化成protel后,在protel中无法
' p- v/ U, }1 L" B9 s7 g进行属性修改,只要一修改,要不不现实,要不就是全显示属性?谢谢!
1 A) z3 [& \) P6 z复:如全显示,可以做一个全局性编辑,只显示希望的部分.

问:请教铺銅的原则?
& m  s/ d3 g3 W0 m2 [# K! l复:铺銅一般应该在你的安全间距的2倍以上.这是LAYOUT的常规知识.

1 b. k) s8 F7 {$ |问:请问Potel DXP在自动布局方面有无改进?导入封装时能否根据原理图的布局自动排开?
+ I' n# X* E0 _" H# b复:PCB布局与原理图布局没有一定的内在必然联系,故此,Potel DXP在自动布局时不会根
- H) A5 q6 c; M4 |据原理图的布局自动排开.(根据子图建立的元件类,可以帮助PCB布局依据原理图的连
# t/ z3 c  U+ N" m0 a: [0 E接).

问:请问信号完整性分析的资料在什么地方购买
复:Protel软件配有详细的信号完整性分析手册.

: d0 V) B8 X7 B: B; @问:为何铺铜,文件哪么大?有何方法?
" {% a! V# H/ N7 k# J. V9 d复:铺铜数据量大可以理解.但如果是过大,可能是您的设置不太科学.
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问:有什么办法让原理图的图形符号可以缩放吗?
7 [; I! ]5 h* u3 H8 @2 m复:不可以.

1 X  O9 |8 e# t6 l问:PROTEL仿真可进行原理性论证,如有详细模型可以得到好的结果
复:PROTEL仿真完全兼容Spice模型,可以从器件厂商处获得免费Spice模型,进行仿真.
PROTEL也提供建模方法,具有专业仿真知识,可建立有效的模型.
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问:99SE中如何加入汉字,如果汉化后好象少了不少东西! 3-28 14:17:0 但确实少了不
+ q2 `) L! F% n& j少功能!
复:可能是汉化的版本不对.

问:如何制作一个孔为2*4MM 外径为6MM的焊盘?
复:在机械层标注方孔尺寸.与制版商沟通具体要求.

, j+ v9 ?# y# i, n1 H# ?问:我知道,但是在内电层如何把电源和地与内电层连接.没有网络表,如果有网络表就没
有问题了
$ ^* W: z( I2 Q+ ]$ E" Z3 t复:利用from-to类生成网络连接
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5 }3 ^3 u6 O2 c, ~" V+ m7 h! t, o2 \- B问:还想请教一下99se中椭圆型焊盘如何制作?放置连续焊盘的方法不可取,线路板厂家不
' h# f* s4 h! @+ c) Z乐意.可否在下一版中加入这个设置项?
复:在建库元件时,可以利用非焊盘的图素形成所要的焊盘形状.在进行PCB设计时使其具
有相同网络属性.我们可以向Protel公司建议.
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" }# r1 K1 }9 K. R8 Q% j; p3 f问:如何免费获取以前的原理图库和pcb库
复:那你可以的WWW.PROTEL.COM下载

* S- f: b0 D( _问:刚才本人提了个在覆铜上如何写上空心(不覆铜)的文字,专家回答先写字,再覆铜,然后
+ w9 `* o- `* Q) e. ^册除字,可是本人试了一下,删除字后,空的没有,被覆铜 覆盖了,请问专家是否搞错了,你能
& C0 ~! I& U, L4 b$ _5 j/ p: j不能试一下
复:字必须用PROTEL99SE提供的放置中文的办法,然后将中文(英文)字解除元件,(因为
9 [8 i% i  B7 ?4 Q+ B) t那是一个元件)将安全间距设置成1MIL,再覆铜,然后移动覆铜,程序会询问是否重新覆
铜,回答NO.
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问:画原理图时,如何元件的引脚次序?
复:原理图建库时,有强大的检查功能,可以检查序号,重复,缺漏等.也可以使用阵列排
2 O. k4 ?1 d$ w3 O5 Z6 p放的功能,一次性放置规律性的引脚.

问:protel99se6自动布线后,在集成块的引脚附近会出现杂乱的走线,像毛刺一般,有时
. f/ ~. k9 Z5 s" X, e0 r& ~# Q8 c甚至是三角形的走线,需要进行大量手工修正,这种问题怎么避免?
4 B8 x! Q9 [3 X9 C! n) b复:合理设置元件网格,再次优化走线.

问:用PROTEL画图,反复修改后,发现文件体积非常大(虚肿),导出后再导入就小了许
多.为什么??有其他办法为文件瘦身吗?
复:其实那时因为PROTEL的铺铜是线条组成的原因造成的,因知识产权问题,不能使用PADS
里的“灌水”功能,但它有它的好处,就是可以自动删除“死铜”.致与文件大,你用
WINZIP压缩一下就很小.不会影响你的文件发送.
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问:请问:在同一条导线上,怎样让它不同部分宽度不一样,而且显得连续美观?谢谢!
$ Z+ S& E2 m) e" L! \复:不能自动完成,可以利用编辑技巧实现.
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1 ?) Q0 ~2 L$ s( G! X/ @& Nliaohm问:如何将一段圆弧进行几等分?
- L# Y8 I$ B3 S6 yfanglin163答复:利用常规的几何知识嘛.EDA只是工具.

* W, \" Z; I+ z3 [7 q问:protel里用的HDL是普通的VHDL
复:Protel PLD不是,Protel FPGA是.
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4 Z6 F# {  U8 l( g# D3 r6 k6 E# l: K/ e问:补泪滴后再铺铜,有时铺出来的网格会残缺,怎么办?
9 P/ i! L6 G" K4 w$ f- F复:那是因为你在补泪滴时设置了热隔离带原因,你只需要注意安全间距与热隔离带方式.
也可以用修补的办法.

# a8 C' w% A8 @: F# w* w. Y: L问:可不可以做不对称焊盘?拖动布线时相连的线保持原来的角度一起拖动?
复:可以做不对称焊盘.拖动布线时相连的线不能直接保持原来的角度一起拖动.

+ d4 \1 V: D! b问:请问当Protel发挥到及至时,是否能达到高端EDA软件同样的效果
复:视设计而定.
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问:Protel DXP的自动布线效果是否可以达到原ACCEL的水平?
复:有过之而无不及.

问:protel的pld功能好象不支持流行的HDL语言?
复:Protel PLD使用的Cupl语言,也是一种HDL语言.下一版本可以直接用VHDL语言输入.

; A9 P) z- \: K0 l9 S$ a; C问:PCB里面的3D功能对硬件有何要求?
, \4 ~/ E2 g0 Z8 R% _- {, g复:需要支持OpenGL.

+ E2 ?. Y( ], f! f& [( f* B9 q8 E) i! I问:如何将一块实物硬制版的布线快速、原封不动地做到电脑之中?
7 N  b  f) ~; g" v- h2 i复:最快的办法就是扫描,然后用BMP2PCB程序转换成胶片文件,然后再修改,但你的PCB精
0 |& E3 ^' J7 k; z1 o9 G度必须在0.2MM以上.BMP2PCB程序可在21IC上下载,你的线路板必须用沙纸打的非常光亮才
% P8 B8 G4 J  Z6 ]; }: O4 `+ F能成功.
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问:直接画PCB板时,如何为一个电路接点定义网络名?
复:在Net编辑对话框中设置.
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问:怎么让做的资料中有孔径显示或符号标志,同allego一样
复:在输出中有选项,可以产生钻孔统计及各种孔径符号.

* a4 D/ {+ I+ y# ], t' z4 h7 D问:自动布线的锁定功能不好用,系统有的会重布,不知道怎么回事?
复:最新的版本无此类问题.

问:如何实现多个原器件的整体翻转
1 P9 Y# k/ ]+ O2 u7 w2 `) p- P3 S复:一次选中所要翻转的元件.

+ X* ^1 c, X- s$ U/ p/ o: C问:我用的p 99 版加入汉字就死机,是什么原因?
- A/ u* Z  D4 N+ G' L7 t复:应是D版所致.

问:powpcb的文件怎样用PROTEL打开?
1 A, _7 n  F" b1 X- i3 `! A复:先新建一PCB文件,然后使用导入功能达到.

问:怎样从PROTEL99中导入GERBER文件
$ C! o3 v; |( v; v7 ^; d复:Protel pcb只能导入自己的Gerber,而Protel的CAM可以导入其它格式的Gerber.


问:PSPICE的功能有没有改变
3 e! W; e& n+ j( h! z3 C: s复:在Protel即将推出的新版本中,仿真功能会有大的提升.

问:如何使用Protel 99se的PLD仿真功能?
5 O+ q2 d& v4 I6 R8 A6 B复:首先要有仿真输入文件(.si),其次在configure中要选择Absolute ABS选项,编译成功
后,可仿真.看仿真输出文件.
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7 P* t$ U  `% l6 i4 P- T" E9 d2 V; k问:protel.ddb历史记录如和删
复:先删除至回收战,然后清空回收站.

# w# L% q  |' J& w问:自动布线为什么会修改事先已布的线而且把它们认为没有布过重新布了而设置我也正确
* z( }- ]4 h1 Z0 d了?
% l; a6 J% g: J- P; w0 G复:把先布的线锁定.应该就可以了.

问:布线后有的线在视觉上明显太差,PROTEL这样布线有他的道理吗(电气上)
复:仅仅通过自动布线,任何一个布线器的结果都不会太美观.
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问:可以在焊盘属性中修改焊盘的X和Y的尺寸
/ i6 }2 A' A6 N( r% ]$ p, I复:可以.

问:protel99se后有没推出新的版本?
- o5 V8 j5 j' _* e  p复:即将推出.该版本耗时2年多,无论在功能、规模上都与Protel99SE,有极大的飞跃.
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0 ?; k* b8 ?3 n/ v7 _! J问:99se的3d功能能更增进些吗?好像只能从正面看!其外形能自己做吗?
9 i- j& U9 U6 Z. Q% L复:3D图形可以用 Ctrl 上,下,左,右 键翻转一定的角度.不过用处不大,显卡
" @) {: q! F; l3 T- z要好才行.
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问:有没有设方孔的好办法?除了在机械层上画.
复:可以,在Multi Layer上设置.
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问:一个问题:填充时,假设布线规则中间距为20mil,但我有些器件要求100mil间距,怎样才
& k& b( p2 G  q9 f能自动填充?
复:可以在design-->rules-->clearance constraint里加
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& L8 R; D5 f, U- q% I) @) q问:在protel中能否用orcad原理图
* l3 m) J) l$ I) m& {2 |% e6 a! F7 _复:需要将orcad原理图生成protel支持的网表文件,再由protel打开即可.
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) L, a0 b' r. w* W* Q. k, \8 }问:请问多层电路板是否可以用自动布线
复:可以的,跟双面板一样的,设置好就行了.
! ~9 ?: H* ]7 L" i 详情可见www.sz-jlc.com/s